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Dissertação (Mestrado)
Projeto de uma fonte de tensão de referência (2014)
Ishibe, Eder Issao; Soares Júnior, João Navarro (Orientador)
Unidade: EESC
Subjects: CIRCUITOS ANALÓGICOS, PROCESSAMENTO DE SINAIS, ALGORITMOS
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ABNT
ISHIBE, Eder Issao. Projeto de uma fonte de tensão de referência. 2014. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2014. Disponível em: http://www.teses.usp.br/teses/disponiveis/18/18155/tde-24072014-165540/. Acesso em: 19 maio 2024.
APA
Ishibe, E. I. (2014). Projeto de uma fonte de tensão de referência (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/18/18155/tde-24072014-165540/
NLM
Ishibe EI. Projeto de uma fonte de tensão de referência [Internet]. 2014 ;[citado 2024 maio 19 ] Available from: http://www.teses.usp.br/teses/disponiveis/18/18155/tde-24072014-165540/
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Ishibe EI. Projeto de uma fonte de tensão de referência [Internet]. 2014 ;[citado 2024 maio 19 ] Available from: http://www.teses.usp.br/teses/disponiveis/18/18155/tde-24072014-165540/
Trabalho de evento
A CMOS bandgap reference circuit with a temperature coefficient adjustment block (2013)
Ishibe, Eder Issao; Soares Júnior, João Navarro
Conference titles: Symposium on Integrated Circuits and Systems Design - SBCCI. Unidade: EESC
Subjects: MÉTODO DE MONTE CARLO, CIRCUITOS INTEGRADOS
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ABNT
ISHIBE, Eder Issao e SOARES JÚNIOR, João Navarro. A CMOS bandgap reference circuit with a temperature coefficient adjustment block. 2013, Anais.. Piscataway: IEEE, 2013. . Acesso em: 19 maio 2024.
APA
Ishibe, E. I., & Soares Júnior, J. N. (2013). A CMOS bandgap reference circuit with a temperature coefficient adjustment block. In . Piscataway: IEEE.
NLM
Ishibe EI, Soares Júnior JN. A CMOS bandgap reference circuit with a temperature coefficient adjustment block. 2013 ;[citado 2024 maio 19 ]
Vancouver
Ishibe EI, Soares Júnior JN. A CMOS bandgap reference circuit with a temperature coefficient adjustment block. 2013 ;[citado 2024 maio 19 ]
Dissertação (Mestrado)
Projeto de amplificadores de baixo ruído usando algoritmos metaheurísticos (2013)
Vera Casañas, César William; Soares Júnior, João Navarro (Orientador)
Unidade: EESC
Subjects: ALGORITMOS GENÉTICOS, TRANSISTORES, RECOZIMENTO (SIMULAÇÃO)
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ABNT
VERA CASAÑAS, César William. Projeto de amplificadores de baixo ruído usando algoritmos metaheurísticos. 2013. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2013. Disponível em: http://www.teses.usp.br/teses/disponiveis/18/18155/tde-18072013-111332/. Acesso em: 19 maio 2024.
APA
Vera Casañas, C. W. (2013). Projeto de amplificadores de baixo ruído usando algoritmos metaheurísticos (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/18/18155/tde-18072013-111332/
NLM
Vera Casañas CW. Projeto de amplificadores de baixo ruído usando algoritmos metaheurísticos [Internet]. 2013 ;[citado 2024 maio 19 ] Available from: http://www.teses.usp.br/teses/disponiveis/18/18155/tde-18072013-111332/
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Vera Casañas CW. Projeto de amplificadores de baixo ruído usando algoritmos metaheurísticos [Internet]. 2013 ;[citado 2024 maio 19 ] Available from: http://www.teses.usp.br/teses/disponiveis/18/18155/tde-18072013-111332/
Dissertação (Mestrado)
Projeto de uma ULA de inteiros e de baixo consumo em tecnologia CMOS (2013)
Sassi, André Berti; Soares Júnior, João Navarro (Orientador)
Unidade: EESC
Assunto: CIRCUITOS INTEGRADOS MOS
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ABNT
SASSI, André Berti. Projeto de uma ULA de inteiros e de baixo consumo em tecnologia CMOS. 2013. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2013. Disponível em: http://www.teses.usp.br/teses/disponiveis/18/18155/tde-26082013-133826/. Acesso em: 19 maio 2024.
APA
Sassi, A. B. (2013). Projeto de uma ULA de inteiros e de baixo consumo em tecnologia CMOS (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/18/18155/tde-26082013-133826/
NLM
Sassi AB. Projeto de uma ULA de inteiros e de baixo consumo em tecnologia CMOS [Internet]. 2013 ;[citado 2024 maio 19 ] Available from: http://www.teses.usp.br/teses/disponiveis/18/18155/tde-26082013-133826/
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Sassi AB. Projeto de uma ULA de inteiros e de baixo consumo em tecnologia CMOS [Internet]. 2013 ;[citado 2024 maio 19 ] Available from: http://www.teses.usp.br/teses/disponiveis/18/18155/tde-26082013-133826/
Dissertação (Mestrado)
Projeto de fontes de tensão de referência através de metaheurísticas (2013)
Sassi, Mariela Mayumi Franchini Sasaki; Soares Júnior, João Navarro (Orientador)
Unidade: EESC
Subjects: CIRCUITOS ANALÓGICOS, HEURÍSTICA, MATLAB
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ABNT
SASSI, Mariela Mayumi Franchini Sasaki. Projeto de fontes de tensão de referência através de metaheurísticas. 2013. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2013. Disponível em: http://www.teses.usp.br/teses/disponiveis/18/18155/tde-26082013-134021/. Acesso em: 19 maio 2024.
APA
Sassi, M. M. F. S. (2013). Projeto de fontes de tensão de referência através de metaheurísticas (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/18/18155/tde-26082013-134021/
NLM
Sassi MMFS. Projeto de fontes de tensão de referência através de metaheurísticas [Internet]. 2013 ;[citado 2024 maio 19 ] Available from: http://www.teses.usp.br/teses/disponiveis/18/18155/tde-26082013-134021/
Vancouver
Sassi MMFS. Projeto de fontes de tensão de referência através de metaheurísticas [Internet]. 2013 ;[citado 2024 maio 19 ] Available from: http://www.teses.usp.br/teses/disponiveis/18/18155/tde-26082013-134021/
Trabalho de evento
A power optimized decimator for sigma-delta data converters (2013)
Carvalho, Dionísio de; Soares Júnior, João Navarro
Conference titles: IEEE Latin American Symposium on Circuits and Systems - LASCAS. Unidade: EESC
Subjects: CONVERSORES A/D E D/A, FILTROS ELÉTRICOS DIGITAIS, CONSUMO DE ENERGIA ELÉTRICA (CONTROLE)
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ABNT
CARVALHO, Dionísio de e SOARES JÚNIOR, João Navarro. A power optimized decimator for sigma-delta data converters. 2013, Anais.. Piscataway: IEEE, 2013. Disponível em: https://doi.org/10.1109/LASCAS.2013.6519018. Acesso em: 19 maio 2024.
APA
Carvalho, D. de, & Soares Júnior, J. N. (2013). A power optimized decimator for sigma-delta data converters. In . Piscataway: IEEE. doi:10.1109/LASCAS.2013.6519018
NLM
Carvalho D de, Soares Júnior JN. A power optimized decimator for sigma-delta data converters [Internet]. 2013 ;[citado 2024 maio 19 ] Available from: https://doi.org/10.1109/LASCAS.2013.6519018
Vancouver
Carvalho D de, Soares Júnior JN. A power optimized decimator for sigma-delta data converters [Internet]. 2013 ;[citado 2024 maio 19 ] Available from: https://doi.org/10.1109/LASCAS.2013.6519018
Trabalho de evento
A bandgap circuit with a temperature coefficient adjustment block (2013)
Ishibe, Eder Issao; Soares Júnior, João Navarro
Conference titles: IEEE International Midwest Symposium on Circuits and Systems - MWSCAS. Unidade: EESC
Subjects: MÉTODO DE MONTE CARLO, HEURÍSTICA, ALGORITMOS
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ABNT
ISHIBE, Eder Issao e SOARES JÚNIOR, João Navarro. A bandgap circuit with a temperature coefficient adjustment block. 2013, Anais.. Piscataway: IEEE, 2013. Disponível em: https://doi.org/10.1109/MWSCAS.2013.6674595. Acesso em: 19 maio 2024.
APA
Ishibe, E. I., & Soares Júnior, J. N. (2013). A bandgap circuit with a temperature coefficient adjustment block. In . Piscataway: IEEE. doi:10.1109/MWSCAS.2013.6674595
NLM
Ishibe EI, Soares Júnior JN. A bandgap circuit with a temperature coefficient adjustment block [Internet]. 2013 ;[citado 2024 maio 19 ] Available from: https://doi.org/10.1109/MWSCAS.2013.6674595
Vancouver
Ishibe EI, Soares Júnior JN. A bandgap circuit with a temperature coefficient adjustment block [Internet]. 2013 ;[citado 2024 maio 19 ] Available from: https://doi.org/10.1109/MWSCAS.2013.6674595
Dissertação (Mestrado)
Projeto de indutores ativos para RF (2011)
Guerreiro, Gabriel Rebello; Soares Júnior, João Navarro (Orientador)
Unidade: EESC
Subjects: TELECOMUNICAÇÕES, CIRCUITOS INTEGRADOS MOS
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ABNT
GUERREIRO, Gabriel Rebello. Projeto de indutores ativos para RF. 2011. Dissertação (Mestrado) – Universidade de São Paulo, São Carlos, 2011. Disponível em: http://www.teses.usp.br/teses/disponiveis/18/18155/tde-14022012-093949/. Acesso em: 19 maio 2024.
APA
Guerreiro, G. R. (2011). Projeto de indutores ativos para RF (Dissertação (Mestrado). Universidade de São Paulo, São Carlos. Recuperado de http://www.teses.usp.br/teses/disponiveis/18/18155/tde-14022012-093949/
NLM
Guerreiro GR. Projeto de indutores ativos para RF [Internet]. 2011 ;[citado 2024 maio 19 ] Available from: http://www.teses.usp.br/teses/disponiveis/18/18155/tde-14022012-093949/
Vancouver
Guerreiro GR. Projeto de indutores ativos para RF [Internet]. 2011 ;[citado 2024 maio 19 ] Available from: http://www.teses.usp.br/teses/disponiveis/18/18155/tde-14022012-093949/
Trabalho de evento
A simple CMOS bandgap reference circuit with sub-1-V operation (2011)
Soares Júnior, João Navarro; Ishibe, Eder Issao
Conference titles: IEEE International Symposium of Circuits and Systems - ISCAS. Unidade: EESC
Subjects: CIRCUITOS INTEGRADOS MOS, CIRCUITOS ELETRÔNICOS
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
SOARES JÚNIOR, João Navarro e ISHIBE, Eder Issao. A simple CMOS bandgap reference circuit with sub-1-V operation. 2011, Anais.. Piscataway, NJ: IEEE, 2011. Disponível em: https://doi.org/10.1109/ISCAS.2011.5938059. Acesso em: 19 maio 2024.
APA
Soares Júnior, J. N., & Ishibe, E. I. (2011). A simple CMOS bandgap reference circuit with sub-1-V operation. In . Piscataway, NJ: IEEE. doi:10.1109/ISCAS.2011.5938059
NLM
Soares Júnior JN, Ishibe EI. A simple CMOS bandgap reference circuit with sub-1-V operation [Internet]. 2011 ;[citado 2024 maio 19 ] Available from: https://doi.org/10.1109/ISCAS.2011.5938059
Vancouver
Soares Júnior JN, Ishibe EI. A simple CMOS bandgap reference circuit with sub-1-V operation [Internet]. 2011 ;[citado 2024 maio 19 ] Available from: https://doi.org/10.1109/ISCAS.2011.5938059
Trabalho de evento-resumo
Aplicação da técnica extended true single phase clock com biblioteca de células em projetos digitais CMOS de alta velocidade (2008)
Calderaro, Felipe Boteon; Soares Júnior, João Navarro
Source: Resumos. Conference titles: Simpósio Internacional de Iniciação Científica da Universidade de São Paulo. Unidade: EESC
Subjects: MICROELETRÔNICA, CIRCUITOS INTEGRADOS MOS
A citação é gerada automaticamente e pode não estar totalmente de acordo com as normas
ABNT
CALDERARO, Felipe Boteon e SOARES JÚNIOR, João Navarro. Aplicação da técnica extended true single phase clock com biblioteca de células em projetos digitais CMOS de alta velocidade. 2008, Anais.. São Paulo: USP, 2008. . Acesso em: 19 maio 2024.
APA
Calderaro, F. B., & Soares Júnior, J. N. (2008). Aplicação da técnica extended true single phase clock com biblioteca de células em projetos digitais CMOS de alta velocidade. In Resumos. São Paulo: USP.
NLM
Calderaro FB, Soares Júnior JN. Aplicação da técnica extended true single phase clock com biblioteca de células em projetos digitais CMOS de alta velocidade. Resumos. 2008 ;[citado 2024 maio 19 ]
Vancouver
Calderaro FB, Soares Júnior JN. Aplicação da técnica extended true single phase clock com biblioteca de células em projetos digitais CMOS de alta velocidade. Resumos. 2008 ;[citado 2024 maio 19 ]

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